本系列將帶來FPGA的系統(tǒng)性學(xué)習(xí),從最基本的數(shù)字電路基礎(chǔ)開始,最詳細(xì)操作步驟,最直白的言語描述,手把手的“傻瓜式”講解,讓電子、信息、通信類專業(yè)學(xué)生、初入職場小白及打算進(jìn)階提升的職業(yè)開發(fā)者都可以有系統(tǒng)性學(xué)習(xí)的機(jī)會。 在之前的設(shè)計(jì)開發(fā)時,利用modelsim得出中間某單元的數(shù)據(jù),并且輸入也是設(shè)計(jì)者在testbench中自己給出的。但是,實(shí)際應(yīng)用時,外部輸入的信號不一定和我們在testbench中所描述輸入的信號相同,就有可能導(dǎo)致RTL仿真成功,但是下板測試失敗。